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数字 IC 设计实习生领跑者计划2026年01月28日岗位职责 1、参与公司高性能低功耗 SoC 的设计与开发，方向涵盖 SoC、通信、AI、CPU、IP 等核心模块； 2、根据产品需求，完成 RTL 设计与实现 3、协助进行仿真验证、FPGA 原型验证及功能调试，推动设计方案落地； 4、负责模块级时序约束、综合、STA 检查等工作，确保设计质量与性能； 5、撰写设计文档，与验证、软件、系统等团队紧密合作，持续优化设计与系统表现。 任职要求 1、硕士及以上学历，微电子、电子工程、通信、计算机或相关专业； 2、扎实的数字电路基础，熟练掌握 Verilog / SystemVerilog 设计与仿真； 3、对芯片架构与系统设计有浓厚兴趣，具备良好的逻辑思维与问题分析能力； 4、有强烈的求知欲与责任心，愿意在工程实践中不断探索、成长、突破。 5、每周实习 3 天及以上，实习时间 3 个月及以上，优秀者可转正。 请注意： 1、请选择最心仪的 1 个岗位进行投递，若有更匹配的岗位，我们将单独与同学确认意愿； 2、官网升级中，暂无法自行查看进度；通过简历初筛的同学将收到邮件或电话联络。campus@espressif.com
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数字 IC 验证实习生领跑者计划2026年01月28日岗位职责1、协助制定模块的验证方案，建立验证环境，完成模块级和芯片级验证；2、协助执行回归测试，提升验证的覆盖率；3、协助 FPGA 工程师和软件工程师完成 FPGA 原型测试；4、配合芯片设计工程师查找修复设计缺陷；5、确认芯片设计的完整性，指导设计部门实现可验证设计流程。任职要求1、硕士及以上学历，计算机/电子工程/通信工程等相关专业;2、熟悉数字芯片 SoC 和通信模块原理;3、熟悉 Verilog，熟悉 C/System Verilog 验证；4、掌握 Python/Ruby/Shell/Tcl 等脚本；5、熟悉 UVM 者优先，有 OOP 编程基础（如C++，Java 等）者优先；6、每周实习 3 天及以上，实习时间 3 个月及以上，优秀者可转正。请注意：1、请选择最心仪的 1 个岗位进行投递，若有更匹配的岗位，我们将单独与同学确认意愿；2、官网升级中，暂无法自行查看进度；通过简历初筛的同学将收到邮件或电话联络。campus@espressif.com
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